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    §2.2 GF100图形架构概况

      在GF100中,抛弃了过去的TPC(Texture Processing Cluster)概念,开始引入GPC(Graphics Processing Cluster)这一名词。GF100的基本结构由一些可伸缩的GPC单元、SM(Streaming Multiprocessor)单元和内存控制器构成。

    GF100架构图

      NVIDIA会推出不同数量GPC、SM和内存控制器搭配的产品以对应不同的价格点,但是一个完整的GF100架构具有4个GPC,16个SM和6个内存控制器。

      CPU的命令通过Host Interface传递给GPU,然后千兆线程(GigaThread)引擎从系统内存取得特定数据并复制到帧缓冲区,GF100拥有6个64-bit的GDDR5内存控制器(总共384-bit),能为通向帧缓冲区提供足够多的带宽。千兆线程引擎创建并分配线程块(thread blocks)给不同的SM,每个SM轮流调度warp给CUDA Core或其它的执行单元。当流水线上一些任务重现时,千兆线程引擎还能重新分配工作给SM,比如光栅化阶段和Tessellation(曲面细分)之后。

      正如在前面介绍Fermi CUDA计算架构所说的,GF100包含有512个CUDA Core,每32个Core组成一个SM,一共有16个SM。每个SM都是高度并行的多核处理器,最多能支持48个warp,也就是能管理1576(48*32)个实时线程,这样16个SM最多可以管理24576个线程。

      每个CUDA Core是一个统一的处理器核心,可以执行顶点、像素、几何和计算Kernel处理任务。另外统一的L2缓存架构能为存、取和纹理操作服务。

      GF100拥有48个ROP单元,应用于像素混合、抗锯齿和原子内存操作等。这些ROP单元每8个一组分为6组,每组与一个64-bit的内存控制器绑定并由之服务。内存控制器、L2缓存和ROP之间的关系是无限亲密的——牵一发而动全局。


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    • 游客  2010-04-15 21:17

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    • 游客  2010-04-05 12:58

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    • 游客  2010-03-31 10:50

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    • 游客  2010-03-30 20:15

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    • 游客  2010-03-29 23:44

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    • 游客  2010-03-27 11:30

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